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Orquestrador de verificação formal SMT-LIB 2.7 / AIGER / BTOR2 (CDCL + BMC + k-indução + interpolação de Craig + IC3)
Uma pilha completa de verificação formal no navegador — sem binário cvc5/Z3: um analisador de scripts SMT-LIB 2.7 para o núcleo QF_BV + Bool com bit-blasting Tseitin dos operadores FixedSizeBitVectors, um leitor AIGER (aag ASCII e aig binário com descodificação delta; saídas como propriedades bad), um leitor BTOR2 com bit-blasting ao nível de palavra e, por baixo, um motor SAT CDCL escrito à mão (literais duplamente vigiados, atividades estilo VSIDS, aprendizagem 1-UIP, reinícios). Em modelos sequenciais executa BMC com traços testemunha, k-indução com reforço de estados únicos, interpolação de Craig estilo McMillan recertificada por SAT e um ciclo IC3/PDR-lite com bloqueio de cubos.
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Chame esta ferramenta a partir do seu código em três idiomas.
curl -X POST 'https://api.elysiatools.com/pt/api/tools/smt-smtlib-2-7-cvc5-z3-btor2-aiger-k-induction-cddr-dbg-invariant-synthesis-orchestrator' \
-H 'Content-Type: application/json' \
-d '{"source":"demo-smt-commutativity","modelText":"(set-logic QF_BV) (assert ...) (check-sat) | aag M I L O A ... | 1 sort bitvec 8 ...","engine":"all","depthK":10}'