Quels formats d'entrée sont pris en charge par le décodeur ?

L'outil accepte les journaux d'états LTSSM horodatés, les lignes d'ensembles ordonnés TS1/TS2, les sorties CSV standards de `pcilmr -o` et les lignes clé-valeur de marge physique.

Comment la génération PCIe est-elle déterminée automatiquement ?

La détection automatique s'appuie sur la valeur EW Min du rapport de marge (18,75 ps pour Gen4, 9,375 ps pour Gen5, 3,125 ps pour Gen6) ou sur les masques d'identifiants de débit présents dans les trames TS1/TS2.

Sur quels critères les statuts Perfect, Pass et Fail sont-ils attribués ?

L'évaluation suit la spécification PCIe Base Spec Rev 5.0 §8.4.2 et les recommandations PHY Test Spec : 'Perfect' pour une marge supérieure aux recommandations, 'Pass' au-dessus des minima requis et 'Fail' en dessous.

Le décodeur prend-il en compte la modulation PAM4 du PCIe Gen6 ?

Oui, pour le PCIe Gen6, l'outil calcule les marges avec un intervalle unitaire (UI) de 31,25 ps adapté à la signalisation multi-niveaux PAM4.

Comment sont identifiées les inversions de polarité ou de voies ?

L'analyseur inspecte les champs d'affectation de lien et de voie dans les jeux TS1/TS2 lors des sous-états Configuration.Lanenum et Configuration.Linkwidth pour signaler les décalages d'indices ou l'inversion de polarité.

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Décodeur LTSSM et Lane Margining PCIe

Décode un journal d’apprentissage de lien PCIe (séquence LTSSM + ensembles ordonnés TS1/TS2) : chronologie Gen1-Gen6, vitesse/largeur négociées, bits d’identifiant de débit, inversions de polarité et de lane, phases d’égalisation et diagnostic des redémarrages ; note aussi les rapports de lane margining (CSV pcilmr) et dessine la carte de chaleur de l’œil.

Détails

Ce que cet outil vous aide à faire

Formats d’entrée (mélangeables, analyse tolérante ligne à ligne) : lignes d’état LTSSM (t=0.9ms Polling.Active), lignes TS1/TS2 avec link=, lane=, rate= (masque 0x01 ou GT/s), ec=, polarity=inverted et indicateurs ; CSV 22 colonnes de pcilmr -o (génération déduite de EW Min : 18,75 ps→Gen4, 9,375→Gen5, 3,125→Gen6) ; lignes clé=valeur lane=2 left_ps=….

Notation Perfect/Pass/Fail selon PCIe Base Spec Rev 5.0 §8.4.2 et recommandations PHY Test Spec, identique à pcilmr(8). Gen6 en PAM4 (UI = 31,25 ps).

Exécution

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Exemples

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logText: 't=0.00ms LTSSM: Detect.Quiet\n...\nt=8.50ms Recovery.Speed\nt=9.20ms Recovery.Equalization.Phase1\nt=9.60ms Recovery.Equalization.Phase2 TS1 link=0 lane=3 ec=01\nt=10.10ms Recovery.Equalization.Phase3 TS1 link=0 lane=3 ec=10\nt=10.70ms L0', pciGen: 'auto', showEyeHeatmap: false

Décodeur LTSSM et Lane Margining PCIe

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Points clés

Aperçu

Quand l’utiliser

Fonctionnement

Cas d’usage

Exemples

1. Débogage de transition de vitesse LTSSM vers Gen5 (32 GT/s)

2. Évaluation de marge de voie avec un CSV pcilmr

FAQ

Échantillons SVG

Exemples SVG

Exemples XML

Echantillons XML

Studio de graphiques CSV : histogramme, nuage de points et boîtes

Découpage train/test stratifié

Générateur de Data URI

Décodeur de certificats X.509